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ATmega128
Table 37. Overriding Signals for Alternate Functions PD7..PD4
Signal Name
PUOE
PUOV
DDOE
DDOV
PVOE
PVOV
DIEOE
DIEOV
DI
AIO
PD7/T2
0
0
0
0
0
0
0
0
T2 INPUT
–
PD6/T1
0
0
0
0
0
0
0
0
T1 INPUT
–
PD5/XCK1
0
0
0
0
UMSEL1
XCK1 OUTPUT
0
0
XCK1 INPUT
–
PD4/ICP1
0
0
0
0
0
0
0
0
ICP1 INPUT
–
Table 38. Overriding Signals for Alternate Functions in PD3..PD0 (1)
Signal Name
PUOE
PUOV
DDOE
DDOV
PVOE
PVOV
DIEOE
DIEOV
DI
AIO
PD3/INT3/TXD1
TXEN1
0
TXEN1
1
TXEN1
TXD1
INT3 ENABLE
1
INT3 INPUT
–
PD2/INT2/RXD1
RXEN1
PORTD2 ? PUD
RXEN1
0
0
0
INT2 ENABLE
1
INT2 INPUT/RXD1
–
PD1/INT1/SDA
T W EN
PORTD1 ? PUD
T W EN
SDA_OUT
T W EN
0
INT1 ENABLE
1
INT1 INPUT
SDA INPUT
PD0/INT0/SCL
T W EN
PORTD0 ? PUD
T W EN
SCL_OUT
T W EN
0
INT0 ENABLE
1
INT0 INPUT
SCL INPUT
Note:
1. W hen enabled, the Two-wire Serial Interface enables Slew-Rate controls on the output pins
PD0 and PD1. This is not shown in this table. In addition, spike filters are connected between
the AIO outputs shown in the port figure and the digital logic of the T W I module.
79
2467X–AVR–06/11
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